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高速并行數(shù)據(jù)串行化中的時(shí)鐘同步電路的制作方法技術(shù)資料下載

技術(shù)編號(hào):7536340

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本發(fā)明涉及數(shù)據(jù)傳輸領(lǐng)域,更具體的來(lái)講,涉及高速并行數(shù)據(jù)串行化中的 一種時(shí)鐘同步的電路。 背景技術(shù)目前,高速并行數(shù)據(jù)串行化技術(shù)主要有兩種樹結(jié)構(gòu)(Tree Architecture) 和移位寄存器結(jié)構(gòu)(Shift-Register Architecture)。樹結(jié)構(gòu)的單元電路為二 到一的并串轉(zhuǎn)換電路(MUX21),隨著并行數(shù)據(jù)位數(shù)的增加而所需的MUX21單元 呈指數(shù)增加,這使得單純采用樹結(jié)構(gòu)的并串轉(zhuǎn)換電路變得規(guī)模龐大,會(huì)導(dǎo)致元 器件體積過大何成本的過高。而移位...
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該專利適合技術(shù)人員進(jìn)行技術(shù)研發(fā)參考以及查看自身技術(shù)是否侵權(quán),增加技術(shù)思路,做技術(shù)知識(shí)儲(chǔ)備,不適合論文引用。
該類技術(shù)注重原理思路,無(wú)完整電路圖,適合研究學(xué)習(xí)。

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