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串并聯(lián)時序邏輯繼電器電路網(wǎng)絡(luò)的制作方法

文檔序號:11656017閱讀:來源:國知局

技術(shù)特征:

技術(shù)總結(jié)
本發(fā)明提出了一種串并聯(lián)時序邏輯繼電器電路網(wǎng)絡(luò),旨在提供一種基于繼電器的高可靠電路執(zhí)行機(jī)構(gòu),以保證需要指令輸出時指令可靠輸出,不需要指令輸出時指令絕對不能輸出。本發(fā)明通過下述技術(shù)方案予以實(shí)現(xiàn):按接點(diǎn)串聯(lián)連接的繼電器串聯(lián)電路和由幾個繼電器接點(diǎn)并聯(lián)連接構(gòu)成的并聯(lián)電路,三路繼電器串聯(lián)電路共端通過輸入端a并聯(lián)連接接收預(yù)令,共端通過輸出端c并聯(lián)連接輸出動令,并且兩組共線通過并聯(lián)線b輸出預(yù)令,從而構(gòu)成至少三路串并聯(lián)時序邏輯繼電器電路網(wǎng)絡(luò),在三路串并聯(lián)時序邏輯繼電器電路網(wǎng)絡(luò)電路中,串并聯(lián)繼電器被分為兩組,兩組以總并聯(lián)的方式共線經(jīng)并聯(lián)線b輸出預(yù)令控制信號,通過動令控制輸入網(wǎng)絡(luò)來實(shí)現(xiàn)繼電器線包的通斷電。

技術(shù)研發(fā)人員:劉來方;陳霞;李軍;陳雅芳
受保護(hù)的技術(shù)使用者:西南電子技術(shù)研究所(中國電子科技集團(tuán)公司第十研究所)
技術(shù)研發(fā)日:2016.11.26
技術(shù)公布日:2017.07.28
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