技術編號：7991329
提示：您尚未登錄，請點 登 陸 后下載，如果您還沒有賬戶請點 注 冊 ，登陸完成后，請刷新本頁查看技術詳細信息。專利摘要一種集成電路被用于數(shù)字信號路由。該集成電路具有模擬和數(shù)字輸入和輸出，包含用于連接到其他集成電路的數(shù)字接口。包含數(shù)字接口的輸入充當數(shù)據(jù)源。包含數(shù)字接口的輸出充當數(shù)據(jù)目的地。該集成電路也包含信號處理塊，該信號處理塊可以充當數(shù)據(jù)源和數(shù)據(jù)目的地。信號路由借助乘累加塊來實現(xiàn)，該乘累加塊從一個或多個數(shù)據(jù)源中提取數(shù)據(jù)，并且在任何所要求的縮放之后，生成用于數(shù)據(jù)目的地的輸出數(shù)據(jù)。來自數(shù)據(jù)源的數(shù)據(jù)被緩沖長達數(shù)據(jù)采樣時鐘的整個周期，以使得該乘累加塊可以在該周期中的任何點取得數(shù)據(jù)，并且該乘累加塊的輸出數(shù)據(jù)被緩沖長達該數(shù)據(jù)采樣時鐘的...
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