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用于配置超低電壓瞬態(tài)電壓抑制器的底部源極n型金屬氧化物半導(dǎo)體觸發(fā)的齊納箝位的制作方法技術(shù)資料下載

技術(shù)編號(hào):6947209

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本發(fā)明普遍涉及一種電路結(jié)構(gòu)以及一種瞬態(tài)電壓抑制器的制作方法。更確切地 說(shuō),本發(fā)明涉及一種改良的電路結(jié)構(gòu)以及一種改良的瞬態(tài)電壓抑制器的制作方法,通過(guò)在 瞬態(tài)電壓抑制器電路中建立一個(gè)底部源極N型金屬氧化硅硅觸發(fā)的齊納箝位結(jié)構(gòu),用于低 壓保護(hù)。背景技術(shù)瞬態(tài)電壓抑制器通常用于保護(hù)集成電路免受因集成電路上突發(fā)的過(guò)電壓帶來(lái)的 損害。集成電路是在電壓的正常范圍內(nèi)設(shè)計(jì)的。然而,一些意外的、不可控的高壓現(xiàn)象,例如 靜電放電、電學(xué)快速瞬變以及二次雷電等,可能會(huì)對(duì)電路產(chǎn)生突然襲...
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