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集成電路版圖的層次網(wǎng)表提取方法技術(shù)資料下載

技術(shù)編號(hào):6538334

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本發(fā)明是一種,屬于集成電路計(jì)算機(jī)輔助設(shè)計(jì)領(lǐng)域,尤其涉及版圖驗(yàn)證領(lǐng)域。背景技術(shù) 版圖驗(yàn)證是集成電路設(shè)計(jì)流程中重要的一環(huán),高效準(zhǔn)確的驗(yàn)證能夠有效的提高集成電路設(shè)計(jì)的效率,能極大降低設(shè)計(jì)失敗的風(fēng)險(xiǎn)。然而隨著工藝不斷的向著納米級(jí)進(jìn)展,在超大規(guī)模集成電路設(shè)計(jì)中,版圖規(guī)模急劇膨脹,傳統(tǒng)的版圖驗(yàn)證方法在計(jì)算速度和內(nèi)存使用方面都遠(yuǎn)遠(yuǎn)落后于用戶的需求。因此,層次的版圖驗(yàn)證方法受到了重視,它的優(yōu)點(diǎn)是利用版圖在設(shè)計(jì)過(guò)程中所具有的層次的特點(diǎn),對(duì)多次重復(fù)出現(xiàn)的版圖只需驗(yàn)證一次,減少...
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